沧不锈钢保温工程 碳化硅(SiC)MOSFET模块硬并联中环流产生的根底机理及综扼制策略

产品中心 2026-01-26 01:38:07 153
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碳化硅(SiC)MOSFET模块硬并联中环流产生的根底机理及综扼制策略辩论报酬沧不锈钢保温工程

BASiC Semiconductor基本半体代理商倾佳电子(Changer Tech)是注于功率半体和新动力汽车蚁集器的分销商。主要服务于工业电源、电力电子开辟和新动力汽车产业链。倾佳电子聚焦于新动力、交通电动化和数字化转型三大向,代理并力BASiC基本半体SiC碳化硅MOSFET单管,SiC碳化硅MOSFET功率模块,SiC模块驱动板等功率半体器件以及新动力汽车蚁集器。

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1. 序言:宽禁带功率器件的并联挑战

跟着电力电子时代向频、压、功率密度向发展,碳化硅(Silicon Carbide, SiC)金属氧化物半体场应晶体管(MOSFET)凭借其超卓的开关速率、低通电阻和耐压特,正慢慢取代传统的硅基IGBT,成为皆集式储能变流器PCS、商用车电驱动及固态变压器等中枢装备的选功率器件 。然而,单颗SiC芯片或单个圭臬功率模块的载流才调时时受限于半体制造工艺的良率及封装散热限,难以温存兆瓦应用对数千安培电流的需求。因此,将多个SiC MOSFET芯片或模块进行“硬并联”(Hard Paralleling)已成为擢升系统功率容量的由之路 。

所谓的硬并联,是指将多个功率器件的栅(Gate)、漏(Drain)和源(Source)分袂径直电气蚁集,使其在逻辑上动作个单的大功率开关就业。然而,SiC MOSFET的开关速率(dv/dt>100V/ns, di/dt>5kA/μs)使其对电路寄生参数的明锐度远传统硅器件 。在硬并联配置中,轻微的器件参数各异或电路布局的分歧称,都会在纳秒的开关瞬态流程中被急剧放大,诱发严重的动态均流失衡。

其中,为祛除且危害巨大的表象是发生在接济源(Auxiliary Source,或称Kelvin Source)回路中的环流,常被称为“S环流”。这种环流不仅会致器件损耗散播不均,可能径直熔断模块里面的键线,致栅失控致使炸机 。倾佳电子杨茜理解SiC模块硬并联中环流产生的根底物理机理,零散是S环流的形成机制,量化其潜在危害,并系统地证明从源扼制到有源驱动的综处罚案。

2. SiC硬并联环流的分类与物理根源

在并联SiC MOSFET系统中,环流(Circulating Current)是指在并联歧路之间流动的非负载电流。左证产生的时辰域和物理机制,环流可分为静态环流和动态环流。固然静态环流主要影响热散播,但动态环流——零散是触及S换流的瞬态电流——是酿成系统失的主要原因。

2.1 静态环流的形成机理

静态环流发生在器件通的稳态阶段,其根底原因在于并联歧路间通电阻(RDS(on))的不匹配 。

ΔIstatic≈Iload⋅∑RDS(on)ΔRDS(on)

尽管SiC MOSFET的通电阻具有正温度统共(PTC),即温度升电阻增大,这种特在定进程上能提供负反馈,扼制热失控(温度的芯片电流减小),但SiC的PTC应不如硅MOSFET权贵 。要是模块里面芯片筛选不严格,好像外部母排蚁集阻抗各异过大,静态不均流仍会致个别芯片遥远过热,加快老化。举例,在BASIC Semiconductor的ED3系列模块中,固然通过热的Si3N4基板化了散热,但严格限度芯片RDS(on)的致仍是并联应用的前提 。

2.2 动态环流与“S环流”的根底原因

动态环流发生在开关瞬态(Turn-on/Turn-off)沧不锈钢保温工程,其幅值可能达到负载电流的数倍。除了器件自己的阈值电压(VGS(th))和跨(gfs)各异外 ,中枢的根源在于寄生电感的耦应与接济源回路的低阻抗特。

2.2.1 阈值电压(VGS(th))与跨失配

VGS(th)决定了器件开启和关断的时辰点。VGS(th)较低的器件会先开启、后关断。在开关流程中,这意味着该器件将在长的时辰窗口内承担负载电流。辩论标明,仅1V的VGS(th)各异就可能致巨大的峰值电流失衡和开关损耗各异 。由于SiC MOSFET的VGS(th)相通随温度升而欺压(举例BMF540R12MZA3从25°C的2.7V降至175°C的1.85V ),这种负温度统共应会形成正反馈:承担多电流的器件温度升,VGS(th)跳跃欺压,从而承担多电流,终致动态热失控。

2.2.2 S环流(接济源环流)的电磁机理

这是SiC并联应用中危急的环流体式。当代SiC模块(如ED3系列)多量接受开尔文源(Kelvin Source / Auxiliary Source)绸缪,以解耦功率回路与驱动回路 。然而,在多模块并联时,这种结构引入了个致命的寄生回路。

物理回路组成:

当两个SiC模块(Module A和Module B)并联时,它们的功率源(Power Source, SPWR)通过外部母排蚁集在起,形成大电流旅途。同期,为了共用同个栅驱动信号,它们的接济源(Auxiliary Source, SAUX)相通在驱动板上蚁集到同个驱动地(Driver GND)。这就形成了个物理闭环:

LoopAux:SPWR_A→SPWR_B→Internal ChipB→SAUX_B→Driver PCB→SAUX_A→Internal ChipA→SPWR_A

电动势驱动机制:

邮箱:215114768@qq.com

由于机械布局的截止,Module A和Module B的功率源寄生电感(LS_PWR)确实不行能颠倒。当总负载电流以的di/dt(举例3 kA/μs)变化时,两个模块功率源电感上感应出的电压(V=L⋅di/dt)将产生各异:

ΔVinduced=(LS_PWR_A−LS_PWR_B)⋅dtdi

这个电压差ΔVinduced径直施加在上述的接济源回路上。

“青少年电子”应(Teenager Electrons): 由于接济源回路相通由里面键线和PCB走线组成,在频下,其阻抗可能低于主功率回路(尽管电阻较大,但电感可能较小)。电流倾向于采用“阻抗低”而非“电阻低”的旅途。这种表象被形象地称为“青少年电子”应——电流像起义的青少年样,不走广大的“主路”(功率母排),而是挤进局促的“小径”(接济源键线)。

由此产生的S环流(Icirc_aux)不再是轻微的信号电流,而是可能达数百安培的能量流。它不是浮浅的均流差错,而是功率回路能量向限度回路的蛮横倒灌。

3. SiC模块硬并联环流的层危害

S环流尽头他动态环流对系统的危害是多维度的,从瞬态的物理损毁到遥远的可靠衰减。

3.1 接济源键线熔断(Catastrophic Failure)

这是S环流径直、致命的成果。

额定值各异: SiC模块里面的功率源键线(Power Source Bond Wires)绸缪用于承载数百安培的负载电流,相通由多根粗铝线或铜线并联。然而,接济源键线(Auxiliary Source Bond Wire)仅绸缪用于传输栅充电电流(相通<10A)和电压采样,为纤细 。 熔断流程: 当di/dt诱发的ΔVinduced驱动数百安培的S环畅通过接济源时,该电流一忽儿过键线的熔断电流(I2t限)。键线会在微秒致使纳秒时辰内飞速气化、熔断 。 成果: 接济源旦断路,栅驱动回路偶然断开。MOSFET的栅将处于浮空情景(Floating Gate)。在米勒电容(Crss)的耦作用下,走电压的波动会将浮空栅电压拉,致器件误通插足线区或纵贯短路。此时,器件将承受全母线电压和短路电流,致一忽儿过热炸裂,致使引发四百四病毁扫数这个词变流器 。

3.2 栅回荡与氧化层击穿(Gate Oscillation & Oxide Stress)

并联系统中的寄生电感(Lg,Ls)与SiC MOSFET的输入电容(Ciss)组成了Q值的LCR谐振收集。

引起原: 的di/dt和S环流动作激励源,易引发该收集的寄生回荡 。 电压过应力: 回荡会致栅源电压(VGS)大幅出安全畛域(相通为+20V/-5V)。正向过压会致栅氧化层(Gate Oxide)发生时经介质击穿(TDDB),设备保温施工欺压器件寿命;负向过压则可能致栅反向击穿。 寄生通: 剧烈的电压回荡若防止阈值电压VGS(th),会致桥臂纵贯。BASIC Semiconductor的文档零散强调了在驱动SiC时使用**米勒钳位(Miller Clamp)**的要,恰是为了止这种由dv/dt和回荡引起的误通 。

3.3 动态热失控与寿命衰减

即使环流未致立即失,遥远的动态不均流也会致并联芯片间的热应力散播不均匀。

热轮回疲惫: 承载大动态电流的芯片会经验剧烈的温度波动(ΔTj)。左证Coffin-Manson模子,这种热轮回会加快芯片焊层和键点的疲惫老化。 陶瓷基板应力: 模块里面的陶瓷基板(如Si3N4 AMB)在反复的热冲击下承受机械应力。固然Si3N4比拟Al2O3具有好的抗弯强度和抗热震(如BMF540R12MZA3所述,能承受1000次热冲击而不分层 ),但遥远的端热叛逆衡仍可能致基板裂纹或铜层剥离。

4. 扼制策略与处罚案

针对SiC硬并联中的环流问题,零散是S换流,工程界如故发展出套从电路拓扑、源器件到有源限度的综扼制策略。

4.1 源扼制案(Passive Suppression)

源扼制是通过在回路中串联阻抗元件来截止环流幅值或阻断环流旅途,是常用且价比的法。

4.1.1 接济源电阻 / 开尔文源电阻 (RKS)

这是止S键线熔断的“圭臬配置”。

旨趣: 在每个并联模块的接济源引脚与驱动器地之间串联个低阻值电阻(RKS)。

作用: 该电阻加多了接济源回路(S环流旅途)的阻抗,从而大幅衰减由LS失配感应出的环流。由于栅驱动电流相对较小且为脉冲状,RKS对通俗驱动波形的影响可控。

选值建议: 辩论标明,RKS的取值相通在 0.5Ω 到 2Ω 之间 。

若阻值过小(<0.5Ω),对大电流环流的扼制果不及,键线仍有风险。 若阻值过大(>5Ω),在大电流关断时,主功率回路的di/dt会在RKS上产生权贵压降,从而对栅电压产生反向偏置(Debiasing),致关断速率变慢,开关损耗加多 。

4.1.2 栅共模电感(Common Mode Choke, CMC)

在栅回路中串联共模电感是扼制频环流的有妙技。

旨趣: 关于通俗的栅驱动电流(差模信号,从Gate流进,从Source流出),CMC呈现低阻抗;而关于在并联模块之间流动的环流(共模信号,从个模块的Source流向另个模块的Source),CMC呈现阻抗 。 势: 比拟单纯加多栅电阻(Rg),CMC不错在不权贵摈弃开关速率的前提下,有阻断由于Vth失配或LS失配引起的动态环流 。实验标明,CMC能将并联电流叛逆衡度从26欺压至3独揽 。

4.1.3 功率回路差模电感(Differential Mode Choke, DMC)

固然主要用于栅,但在源功率旅途中引入差模电感(或耦电感)也不错强制均流。

旨趣: 愚弄磁耦旨趣,当两路电流叛逆衡时,磁通不对消,电感呈现阻抗对抗电流变化;当电流均衡时,磁通对消,阻抗接近 。 局限: 由于需要承载主功率电流,DMC体积广泛,且会加多主回路电感,这与SiC追求低电感绸缪的初志相反,因此在功率密度模块中应用较少 。

4.1.4 磁珠(Ferrite Beads)

在栅和源引脚套接磁珠,愚弄其频损耗特来糜掷回荡能量,扼制主要由寄生参数引起的频栅回荡(几十MHz以上)。

4.2 有源扼制与驱动策略(Active Suppression)

有源案通过智能调整栅信号来动态赔偿器件各异。

4.2.1 有源栅驱动(Active Gate Driver, AGD)

延长赔偿: AGD检测电流过点或开启时刻,对Vth较低(开启较快)的器件施加微秒的驱动延长,使其与慢速器件同步 。 多电平驱动: 通过输出路线状的栅电压,限度di/dt的变化率,从而减小寄生电感上的感应电压差,转折扼制环流 。 闭环限度: 及时监测每个歧路的源电流,动态调整下周期的驱动电压幅值或时序 。

4.2.2 立的栅驱动架构

的解耦式是为每个并联模块配备立的遮盖驱动器(或立的光耦/遮盖)。

旨趣: 每个模块领有立的驱动回路,接济源不再径直硬蚁集,而是通过光耦或磁遮盖解耦。这从物理上堵截了S环流的旅途。 过失: 系统资本权贵加多,且需要其精准地限度各路驱动信号的同步(Skew time),不然驱动信号自己的时差会引发新的不均流 。

4.3 模块里面与系统布局化

从泉源摒除不细目是的策略。

对称布局(Symmetry): 论是PCB绸缪如故母排绸缪,须严格遵命“蝴蝶型”或“星型”对称布局,确保扫数并联歧路的功率旅途(Ld,Ls)和驱动旅途(Lg)阻抗致 。 基板材料采用: 选用可靠基板如Si3N4 AMB,愚弄其热率和机械强度,增强模块对残留不均流引起的热应力的耐受才调,止因局部过热致的基板分层 。 径直源互连(Direct Source Interconnection, DSI): 新的辩论提倡在并联芯片的源之间加多低电感的互连线,通过强耦强制电位拉平,从拓扑上扼制驱动回路的差模电压 。

5. 论断与建议

圳市倾佳电子有限公司(简称“倾佳电子”)是聚焦新动力与电力电子变革的中枢动者:

倾佳电子建树于2018年,总部位于圳福田区,定位于功率半体与新动力汽车蚁集器的业分销商,业务聚焦三大向:

新动力:覆盖光伏、储能、充电基础步地;

交通电动化:服务新动力汽车三电系统(电控、电板、电机)及压平台升;

数字化转型:相沿AI算力电源、数据中心等新式电力电子应用。

公司以“动国产SiC替代、加快动力低碳转型”为职责,反应国“双碳”计谋(碳达峰、碳中庸),奋发于欺压电力电子系统能耗。代理并力BASiC基本半体SiC碳化硅MOSFET单管,BASiC基本半体SiC碳化硅MOSFET功率模块,BASiC基本半体SiC模块驱动板等功率半体器件以及新动力汽车蚁集器。

SiC MOSFET模块的硬并联应用是通向功率电力电子系统的经之路,但其濒临的“S换流”挑战阻难疏远。该表象的行是频开关瞬态下,功率回路的电磁能量通过寄生电感各异耦进脆弱的驱动回路。其径直成果是接济源键线的熔断和模块的废弃失。

为确保系统安全,工程绸缪须选定分层御策略:

基础御: 在每个并联模块的接济源处须串联0.5Ω∼2Ω的电阻,这是止键线熔断的后谈线。 能化: 接受**栅共模电感(CMC)**来扼制频回荡,同期不摈弃开关速率。 驱动保护: 驱动器须具备**米勒钳位(Miller Clamp)**,止dv/dt诱发的误通,并荐使器具有立遮盖或同步的驱动案。 器件选型: 先采用参数致好(Vth分档)、接受强度Si3N4基板的模块(如BASIC ED3系列),从物理层面提系统的鲁棒。

通过上述综设施沧不锈钢保温工程,不错有谨守SiC MOSFET的“野”,在享受其频势的同期,确保并联系统的遥远可靠入手。

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